jspc29.x-matter.uni-frankfurt.de Git - mvd_firmware.git/blob

   1 /**\r
   2   ******************************************************************************\r
   3   * @file      startup_stm32f10x_ld_vl.s\r
   4   * @author    MCD Application Team\r
   5   * @version   V3.5.0\r
   6   * @date      11-March-2011\r
   7   * @brief     STM32F10x Low Density Value Line Devices vector table for Atollic toolchain.\r
   8   *            This module performs:\r
   9   *                - Set the initial SP\r
  10   *                - Set the initial PC == Reset_Handler,\r
  11   *                - Set the vector table entries with the exceptions ISR address\r
  12   *                - Configure the clock system   \r
  13   *                - Branches to main in the C library (which eventually\r
  14   *                  calls main()).\r
  15   *            After Reset the Cortex-M3 processor is in Thread mode,\r
  16   *            priority is Privileged, and the Stack is set to Main.\r
  17   ******************************************************************************\r
  18   * @attention\r
  19   *\r
  20   * THE PRESENT FIRMWARE WHICH IS FOR GUIDANCE ONLY AIMS AT PROVIDING CUSTOMERS\r
  21   * WITH CODING INFORMATION REGARDING THEIR PRODUCTS IN ORDER FOR THEM TO SAVE\r
  22   * TIME. AS A RESULT, STMICROELECTRONICS SHALL NOT BE HELD LIABLE FOR ANY\r
  23   * DIRECT, INDIRECT OR CONSEQUENTIAL DAMAGES WITH RESPECT TO ANY CLAIMS ARISING\r
  24   * FROM THE CONTENT OF SUCH FIRMWARE AND/OR THE USE MADE BY CUSTOMERS OF THE\r
  25   * CODING INFORMATION CONTAINED HEREIN IN CONNECTION WITH THEIR PRODUCTS.\r
  26   *\r
  27   * <h2><center>&copy; COPYRIGHT 2011 STMicroelectronics</center></h2>\r
  28   ******************************************************************************\r
  29   */\r
  30 \r
  31   .syntax unified\r
  32         .cpu cortex-m3\r
  33         .fpu softvfp\r
  34         .thumb\r
  35 \r
  36 .global g_pfnVectors\r
  37 .global Default_Handler\r
  38 \r
  39 /* start address for the initialization values of the .data section.\r
  40 defined in linker script */\r
  41 .word   _sidata\r
  42 /* start address for the .data section. defined in linker script */\r
  43 .word   _sdata\r
  44 /* end address for the .data section. defined in linker script */\r
  45 .word   _edata\r
  46 /* start address for the .bss section. defined in linker script */\r
  47 .word   _sbss\r
  48 /* end address for the .bss section. defined in linker script */\r
  49 .word   _ebss\r
  50 \r
  51 .equ  BootRAM, 0xF108F85F\r
  52 /**\r
  53  * @brief  This is the code that gets called when the processor first\r
  54  *          starts execution following a reset event. Only the absolutely\r
  55  *          necessary set is performed, after which the application\r
  56  *          supplied main() routine is called.\r
  57  * @param  None\r
  58  * @retval : None\r
  59 */\r
  60 \r
  61     .section    .text.Reset_Handler\r
  62         .weak   Reset_Handler\r
  63         .type   Reset_Handler, %function\r
  64 Reset_Handler:\r
  65 \r
  66 /* Copy the data segment initializers from flash to SRAM */\r
  67   movs  r1, #0\r
  68   b     LoopCopyDataInit\r
  69 \r
  70 CopyDataInit:\r
  71         ldr     r3, =_sidata\r
  72         ldr     r3, [r3, r1]\r
  73         str     r3, [r0, r1]\r
  74         adds    r1, r1, #4\r
  75 \r
  76 LoopCopyDataInit:\r
  77         ldr     r0, =_sdata\r
  78         ldr     r3, =_edata\r
  79         adds    r2, r0, r1\r
  80         cmp     r2, r3\r
  81         bcc     CopyDataInit\r
  82         ldr     r2, =_sbss\r
  83         b       LoopFillZerobss\r
  84 /* Zero fill the bss segment. */\r
  85 FillZerobss:\r
  86         movs    r3, #0\r
  87         str     r3, [r2], #4\r
  88 \r
  89 LoopFillZerobss:\r
  90         ldr     r3, = _ebss\r
  91         cmp     r2, r3\r
  92         bcc     FillZerobss\r
  93 \r
  94 /* Call the clock system intitialization function.*/\r
  95   bl  SystemInit  \r
  96 /* Call static constructors */\r
  97   bl __libc_init_array \r
  98 /* Call the application's entry point.*/\r
  99         bl      main\r
 100         bx      lr\r
 101 .size   Reset_Handler, .-Reset_Handler\r
 102 \r
 103 /**\r
 104  * @brief  This is the code that gets called when the processor receives an\r
 105  *         unexpected interrupt.  This simply enters an infinite loop, preserving\r
 106  *         the system state for examination by a debugger.\r
 107  *\r
 108  * @param  None\r
 109  * @retval : None\r
 110 */\r
 111     .section    .text.Default_Handler,"ax",%progbits\r
 112 Default_Handler:\r
 113 Infinite_Loop:\r
 114         b       Infinite_Loop\r
 115         .size   Default_Handler, .-Default_Handler\r
 116 /******************************************************************************\r
 117 *\r
 118 * The minimal vector table for a Cortex M3.  Note that the proper constructs\r
 119 * must be placed on this to ensure that it ends up at physical address\r
 120 * 0x0000.0000.\r
 121 *\r
 122 ******************************************************************************/\r
 123         .section        .isr_vector,"a",%progbits\r
 124         .type   g_pfnVectors, %object\r
 125         .size   g_pfnVectors, .-g_pfnVectors\r
 126 \r
 127 \r
 128 g_pfnVectors:\r
 129         .word   _estack\r
 130         .word   Reset_Handler\r
 131         .word   NMI_Handler\r
 132         .word   HardFault_Handler\r
 133         .word   MemManage_Handler\r
 134         .word   BusFault_Handler\r
 135         .word   UsageFault_Handler\r
 136         .word   0\r
 137         .word   0\r
 138         .word   0\r
 139         .word   0\r
 140         .word   SVC_Handler\r
 141         .word   DebugMon_Handler\r
 142         .word   0\r
 143         .word   PendSV_Handler\r
 144         .word   SysTick_Handler\r
 145         .word   WWDG_IRQHandler\r
 146         .word   PVD_IRQHandler\r
 147         .word   TAMPER_IRQHandler\r
 148         .word   RTC_IRQHandler\r
 149         .word   FLASH_IRQHandler\r
 150         .word   RCC_IRQHandler\r
 151         .word   EXTI0_IRQHandler\r
 152         .word   EXTI1_IRQHandler\r
 153         .word   EXTI2_IRQHandler\r
 154         .word   EXTI3_IRQHandler\r
 155         .word   EXTI4_IRQHandler\r
 156         .word   DMA1_Channel1_IRQHandler\r
 157         .word   DMA1_Channel2_IRQHandler\r
 158         .word   DMA1_Channel3_IRQHandler\r
 159         .word   DMA1_Channel4_IRQHandler\r
 160         .word   DMA1_Channel5_IRQHandler\r
 161         .word   DMA1_Channel6_IRQHandler\r
 162         .word   DMA1_Channel7_IRQHandler\r
 163         .word   ADC1_IRQHandler\r
 164         .word   0\r
 165         .word   0\r
 166         .word   0\r
 167         .word   0\r
 168         .word   EXTI9_5_IRQHandler\r
 169         .word   TIM1_BRK_TIM15_IRQHandler\r
 170         .word   TIM1_UP_TIM16_IRQHandler\r
 171         .word   TIM1_TRG_COM_TIM17_IRQHandler\r
 172         .word   TIM1_CC_IRQHandler\r
 173         .word   TIM2_IRQHandler\r
 174         .word   TIM3_IRQHandler\r
 175         .word   0\r
 176         .word   I2C1_EV_IRQHandler\r
 177         .word   I2C1_ER_IRQHandler\r
 178         .word   0\r
 179         .word   0\r
 180         .word   SPI1_IRQHandler\r
 181         .word   0\r
 182         .word   USART1_IRQHandler\r
 183         .word   USART2_IRQHandler\r
 184         .word   0\r
 185         .word   EXTI15_10_IRQHandler\r
 186         .word   RTCAlarm_IRQHandler\r
 187         .word   CEC_IRQHandler\r
 188         .word   0\r
 189         .word   0\r
 190         .word   0\r
 191         .word   0\r
 192         .word   0\r
 193         .word   0\r
 194         .word   0\r
 195         .word 0  \r
 196         .word 0\r
 197         .word 0\r
 198         .word 0\r
 199         .word TIM6_DAC_IRQHandler\r
 200         .word TIM7_IRQHandler  \r
 201         .word 0\r
 202         .word 0\r
 203         .word 0\r
 204         .word 0\r
 205         .word 0\r
 206         .word 0\r
 207         .word 0\r
 208         .word 0\r
 209         .word 0\r
 210         .word 0\r
 211         .word 0\r
 212         .word 0\r
 213         .word 0\r
 214         .word 0\r
 215         .word 0\r
 216         .word 0\r
 217         .word 0\r
 218         .word 0\r
 219         .word 0\r
 220         .word 0\r
 221         .word 0\r
 222         .word 0\r
 223         .word 0\r
 224         .word 0\r
 225         .word 0\r
 226         .word 0\r
 227         .word 0\r
 228         .word 0\r
 229         .word 0\r
 230         .word 0\r
 231         .word 0\r
 232         .word 0\r
 233         .word 0\r
 234         .word 0\r
 235         .word 0\r
 236         .word 0\r
 237         .word 0\r
 238         .word 0\r
 239         .word 0\r
 240         .word 0\r
 241         .word 0\r
 242         .word 0\r
 243         .word 0\r
 244         .word BootRAM          /* @0x01CC. This is for boot in RAM mode for \r
 245                             STM32F10x Medium Value Line Density devices. */\r
 246 \r
 247 /*******************************************************************************\r
 248 *\r
 249 * Provide weak aliases for each Exception handler to the Default_Handler.\r
 250 * As they are weak aliases, any function with the same name will override\r
 251 * this definition.\r
 252 *\r
 253 *******************************************************************************/\r
 254 \r
 255     \r
 256   .weak  NMI_Handler\r
 257   .thumb_set NMI_Handler,Default_Handler\r
 258   \r
 259   .weak  HardFault_Handler\r
 260   .thumb_set HardFault_Handler,Default_Handler\r
 261   \r
 262   .weak  MemManage_Handler\r
 263   .thumb_set MemManage_Handler,Default_Handler\r
 264   \r
 265   .weak  BusFault_Handler\r
 266   .thumb_set BusFault_Handler,Default_Handler\r
 267 \r
 268   .weak  UsageFault_Handler\r
 269   .thumb_set UsageFault_Handler,Default_Handler\r
 270 \r
 271   .weak  SVC_Handler\r
 272   .thumb_set SVC_Handler,Default_Handler\r
 273 \r
 274   .weak  DebugMon_Handler\r
 275   .thumb_set DebugMon_Handler,Default_Handler\r
 276 \r
 277   .weak  PendSV_Handler\r
 278   .thumb_set PendSV_Handler,Default_Handler\r
 279 \r
 280   .weak  SysTick_Handler\r
 281   .thumb_set SysTick_Handler,Default_Handler\r
 282 \r
 283   .weak  WWDG_IRQHandler\r
 284   .thumb_set WWDG_IRQHandler,Default_Handler\r
 285 \r
 286   .weak  PVD_IRQHandler\r
 287   .thumb_set PVD_IRQHandler,Default_Handler\r
 288 \r
 289   .weak  TAMPER_IRQHandler\r
 290   .thumb_set TAMPER_IRQHandler,Default_Handler\r
 291 \r
 292   .weak  RTC_IRQHandler\r
 293   .thumb_set RTC_IRQHandler,Default_Handler\r
 294 \r
 295   .weak  FLASH_IRQHandler\r
 296   .thumb_set FLASH_IRQHandler,Default_Handler\r
 297 \r
 298   .weak  RCC_IRQHandler\r
 299   .thumb_set RCC_IRQHandler,Default_Handler\r
 300 \r
 301   .weak  EXTI0_IRQHandler\r
 302   .thumb_set EXTI0_IRQHandler,Default_Handler\r
 303 \r
 304   .weak  EXTI1_IRQHandler\r
 305   .thumb_set EXTI1_IRQHandler,Default_Handler\r
 306 \r
 307   .weak  EXTI2_IRQHandler\r
 308   .thumb_set EXTI2_IRQHandler,Default_Handler\r
 309 \r
 310   .weak  EXTI3_IRQHandler\r
 311   .thumb_set EXTI3_IRQHandler,Default_Handler\r
 312 \r
 313   .weak  EXTI4_IRQHandler\r
 314   .thumb_set EXTI4_IRQHandler,Default_Handler\r
 315 \r
 316   .weak  DMA1_Channel1_IRQHandler\r
 317   .thumb_set DMA1_Channel1_IRQHandler,Default_Handler\r
 318 \r
 319   .weak  DMA1_Channel2_IRQHandler\r
 320   .thumb_set DMA1_Channel2_IRQHandler,Default_Handler\r
 321 \r
 322   .weak  DMA1_Channel3_IRQHandler\r
 323   .thumb_set DMA1_Channel3_IRQHandler,Default_Handler\r
 324 \r
 325   .weak  DMA1_Channel4_IRQHandler\r
 326   .thumb_set DMA1_Channel4_IRQHandler,Default_Handler\r
 327 \r
 328   .weak  DMA1_Channel5_IRQHandler\r
 329   .thumb_set DMA1_Channel5_IRQHandler,Default_Handler\r
 330 \r
 331   .weak  DMA1_Channel6_IRQHandler\r
 332   .thumb_set DMA1_Channel6_IRQHandler,Default_Handler\r
 333 \r
 334   .weak  DMA1_Channel7_IRQHandler\r
 335   .thumb_set DMA1_Channel7_IRQHandler,Default_Handler\r
 336 \r
 337   .weak  ADC1_IRQHandler\r
 338   .thumb_set ADC1_IRQHandler,Default_Handler\r
 339 \r
 340   .weak  EXTI9_5_IRQHandler\r
 341   .thumb_set EXTI9_5_IRQHandler,Default_Handler\r
 342 \r
 343   .weak  TIM1_BRK_TIM15_IRQHandler\r
 344   .thumb_set TIM1_BRK_TIM15_IRQHandler,Default_Handler\r
 345 \r
 346   .weak  TIM1_UP_TIM16_IRQHandler\r
 347   .thumb_set TIM1_UP_TIM16_IRQHandler,Default_Handler\r
 348 \r
 349   .weak  TIM1_TRG_COM_TIM17_IRQHandler\r
 350   .thumb_set TIM1_TRG_COM_TIM17_IRQHandler,Default_Handler\r
 351 \r
 352   .weak  TIM1_CC_IRQHandler\r
 353   .thumb_set TIM1_CC_IRQHandler,Default_Handler\r
 354 \r
 355   .weak  TIM2_IRQHandler\r
 356   .thumb_set TIM2_IRQHandler,Default_Handler\r
 357 \r
 358   .weak  TIM3_IRQHandler\r
 359   .thumb_set TIM3_IRQHandler,Default_Handler\r
 360 \r
 361   .weak  I2C1_EV_IRQHandler\r
 362   .thumb_set I2C1_EV_IRQHandler,Default_Handler\r
 363 \r
 364   .weak  I2C1_ER_IRQHandler\r
 365   .thumb_set I2C1_ER_IRQHandler,Default_Handler\r
 366 \r
 367   .weak  SPI1_IRQHandler\r
 368   .thumb_set SPI1_IRQHandler,Default_Handler\r
 369 \r
 370   .weak  USART1_IRQHandler\r
 371   .thumb_set USART1_IRQHandler,Default_Handler\r
 372 \r
 373   .weak  USART2_IRQHandler\r
 374   .thumb_set USART2_IRQHandler,Default_Handler\r
 375 \r
 376   .weak  EXTI15_10_IRQHandler\r
 377   .thumb_set EXTI15_10_IRQHandler,Default_Handler\r
 378 \r
 379   .weak  RTCAlarm_IRQHandler\r
 380   .thumb_set RTCAlarm_IRQHandler,Default_Handler\r
 381 \r
 382   .weak  CEC_IRQHandler\r
 383   .thumb_set CEC_IRQHandler,Default_Handler\r
 384 \r
 385   .weak  TIM6_DAC_IRQHandler\r
 386   .thumb_set TIM6_DAC_IRQHandler,Default_Handler\r
 387 \r
 388   .weak  TIM7_IRQHandler\r
 389   .thumb_set TIM7_IRQHandler,Default_Handler  \r
 390 \r
 391 /******************* (C) COPYRIGHT 2011 STMicroelectronics *****END OF FILE****/\r
 392 \r